经过生产验证的,复杂的半导体IP核

半导体电路设计IP及配套交付件


T2M Verification IPs 1G Ethernet VIP

1G Ethernet VIP

概述和功能介绍

以太网 1G 验证 IP 根据 IEEE 802.3 规范,使用以太网 1G 接口验证设计的 MAC 到 PHY 和 PHY-到 MAC 层接口。 它可以在使用SystemVerilog,Vera,SystemC,E和Verilog HDL的环境中运行。 曾为英特尔、Cortina-Systems、Emulex和思科等企业工作的以太网专家创建了以太网1G验证IP。 我们知道验证以太网产品所涉及的步骤。 SystemVerilog,VMM,RVM,AVM,OVM,UVM,Verilog,SystemC,VERA,Specman E和非标准验证环境都原生支持以太网1G验证IP。 以太网 1G 验证 IP 中包含可选的智能可视协议调试器,这是一种基于 GUI 的调试器,用于加快调试速度。 

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功能描述
  • 支持 1G • 支持 GMII • 支持 TBI(即 8b/10b PCS 的输出) • 支持 SGMII(10M/100M/1000M) 符合规范 1.8 • 支持 QSGMII 符合规范 1.2 • 支持 USGMII 符合规范 3.0 和 3.1(5G 和 10G) • 支持 RGMII(10M/100M/1000M),RTBI 符合规范 2.0 • 支持 1000Base-KX • 支持 1GBASE-SX 和 1GBASE-LX • 支持条款 73 背板自动协商或 1000Base-KX • 支持条款 37 自动协商 • 支持 SGMII 自动协商 • 支持QSGMII 自动协商 • 支持 USGMII 自动协商和数据包 • 支持全双工和半双工操作

  • 支持 G.999.1 接口

  • 以太网验证 IP 附带完整的 UNH 测试套件

  • 支持上层协议

  • 支持 IP 中的 IP 和 Q 中的 Q

  • 完全支持 IEEE 802.1AZ(高能效以太网)

  • 完全支持 IEEE 1588-2002 和 IEEE 1588-2008

  • PCS 到 Serdes 接口支持所有宽度

  • 支持串行协议的 CDR

  • 根据第 22 条和第 45 条支持 MDIO 从站和主站模型

  • 支持毛刺插入和检测

  • 支持暂停帧生成和检测

  • 支持每层所有类型的 TX 和 RX 错误插入/检测。

  • 下框和超大框架。

  • CRC 错误、成帧错误

  • 暂停帧错误

  • 差异和自动协商错误

  • 代码组插入无效

  • 无效的 /K/ 字符插入

  • 车道倾斜插入

  • 无效的 AN 序列错误插入

  • 数据包边界缺少 /K/ 字符。

  • 随附 Tx BFM、Rx BFM 和监视器

  • 监视器支持检测所有协议冲突

  • 内置覆盖率分析

  • 主站和从站中各种事件的回调

可交付成果

  • 用户指南和发行说明 包含所有测试用例的完整回归套件。

  • 示例显示如何连接各种组件,以及 TX、RX BFM 和监视器的用法。

  • 验证环境中使用的所有类、任务和函数的详细文档。

  • 文档还包含