经过生产验证的,复杂的半导体IP核

半导体电路设计IP及配套交付件


T2M Verification IPs MIPI A-PHY 验证IP

MIPI A-PHY 验证IP

概述和功能介绍

使用 MIPI A-PHY 可以快速、轻松地验证 MIPI A-PHY。 MIPI APHY 的验证 IP 提供以下功能,并且完全兼容 MIPI A-PHY 1.0 和 1.1 规范。 SystemVerilog、VMM、RVM、AVM、OVM、UVM、Verilog、SystemC、VERA、Specman E 和非标准验证环境都原生支持 MIPI A-PHY 验证 IP。 MIPI A-PHY 验证 IP 还包含可选的智能视觉协议调试器,这是一种基于 GUI 的调试器,可加快调试速度。

 

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功能描述
  • 支持 MIPI A-PHY 规范 1.0 和 1.1。

  • 支持单通道和双通道、点对点和串行通信技术。

  • MIPI A-PHY 提供主要的单向数据流和双向低吞吐量命令和控制数据流,并且还可以选择向外围单元(即网络边缘的传感器和/或显示器)提供所需的电源。 )直接通过 A-PHY 数据线。

  • 该模型具有一组丰富的配置参数来控制 MIPI A-PHY 功能。

  • 支持从 2Gbps 到 32 Gbps 的多种速度档位。

  • 支持 5 个独立的下行链路档位:G1、G2、G3、G4 和 G5,上行链路在 U1 和 U2 档位应为 200Mbps

  • 支持两种类型的配置文件: • 配置文件 1 (P1-NRZ 8B/10B) • 配置文件 2 (P2 -PAM 4, 8 ,16)

  • 支持时钟恢复,Sink Transmitter应使用恢复的Source时钟来生成正确的Sink发送时钟,以达到正确的端口速率。

  • 支持重传请求/ACK类型。

  • 根据规格支持扰频器。

  • 支持两种类型的启动程序: 任务模式、单向启动

  • 支持唤醒协议及以下操作模式:非活动模式、活动模式

  • 实现以下 PHY 层架构: • MIPI A-PHY P1 G1/G2 架构 • RTS 旁路、8B/10B PCS、PMD • MIPI A-PHY P2 G1/G2 架构 • 用于上行链路和下行链路的 RTS • 8B/10B PCS、 PMD • MIPI A-PHY G3-G5 架构 • 用于上行链路和下行链路的 RTS,用于上行链路的 8B/10B PCS • 用于下行链路的 PAM 4, 8 ,16 PCS,PMD

  • 支持以下数据链接功能:

  • 链接服务、本地功能、多端口功能

  • 网络功能

  • 监控、检测并通知测试平台重大事件,例如事务、警告、计时和协议违规。

  • 发送器和接收器中针对各种事件的回调。

  • MIPI A-PHY 验证 IP 附带完整的测试套件,用于测试 MIPI A-PHY 的每个功能。

交付

  • 包含所有 MIPI APHY 测试用例的完整回归套件。

  • 示例展示了如何连接各种组件以及 Tx、Rx 和 Monitor 的用法。

  • 验证环境中使用的所有类、任务和函数的详细文档。

  • 文档还包含用户指南和发行说明