概述和功能介绍
一款低功耗、高性能的物联网、微控制器等领域专用 32 位 RISC-V 嵌入式通用处理器。为进一步提升性能， 新增一级缓存（L1 cache）、B 扩展、F 扩展、Zicbom 缓存操作扩展及 Smepmp 安全扩展。专为嵌入式轻量
化微控制器应用设计。
功能描述
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ISA：RV32 IMAC(B)(F)_Zicsr_Zifencei_Zicbom
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工作模式（Modes）：机器模式（Machine-Mode）、用户模式（User-Mode）
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流水线结构（Pipeline）：2 级流水线
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浮点运算单元（FPU）：可选配浮点运算单元（FPU），支持单精度浮点运算
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安全性能（Security）：支持 Smepmp 安全扩展；可选配物理内存保护单元（PMP），保护区域可配置 0
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至 16 个
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一级指令缓存（L1 I$）：一级指令缓存（L1 I$）容量可配置，范围 4KB 至 128KB，支持奇偶校验
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（Parity）
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一级数据缓存（L1 D$）：一级数据缓存（L1 D$）容量可配置，范围 4KB 至 128KB，支持奇偶校验
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（Parity）
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紧密集成内存（TIM）：可选配紧密集成内存（TIM），含 TIM0 与 TIM1，容量可配置范围 0KB 至
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128MB
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中断功能（Interrupt）：
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支持核心本地中断控制器（CLIC），最多 112 路快速中断
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支持不可屏蔽中断（NMI）
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调试功能（Debug）：
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调试模块支持 JTAG/cJTAG 接口
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触发模块最多支持 16 个硬件断点
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总线接口（Bus Interface）：3 个 32 位 AHB（高级高性能总线）主接口、1 个 32 位 AHB 从接口
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CoreMark 性能：4.65 CoreMarks/MHz
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Dhrystone-Legla 性能：1.90 DMIPS/MH
应用场景
交付内容
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IP 包
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可综合 RISC-V CPU IP 核
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含测试案例演示的仿真环境
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IP 用户手册/集成手册/仿真手册/功能安全手册（如支持）
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FPGA 开发板支持包
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FPGA 开发板
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用户手册
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线上技术支持
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线下技术支持
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集成开发环境（IDE）包
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集成开发环境（支持 Windows + Linux 双系统版本）
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用户指南
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预编译工具套件
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预构建项目演示案例
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自动化调试与跟踪流程
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工具链包
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基于 GCC13/GCC14 的工具链
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编译器、汇编器、链接器
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QEMU 模拟器
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GDB 调试器
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基础库文件
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开发套件（SDK）
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32 位 IP 专用 MCU 开发套件（含 EMSIS 标准支持、RTOS 支持、RTOS 中断嵌套支持等）
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64 位 IP 专用 Linux 开发套件（支持 Linux 操作系统）
